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发明专利
已授权
基于FPGA的标记面积块下限分离分道方法
📄 申请号:CN201810936890.5
📄 发布日:2026/07/23
著录项目信息
申请日
2018-08-16
公开号
CN109102540B
公开日
2022-01-28
申请人
杭州电子科技大学
法律状态
已下证
专利类型
发明
主分类号
G06T7_62
IPC 分类号
G06T7_62
,
G06T7_70
,
技术画像
所属领域
FPGA技术
FPGA技术
图像处理
数字电路设计
应用场景
工业视觉检测, 图像分割, 智能交通, 目标识别, 实时图像分析
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摘要
本发明公开了基于FPGA的标记面积块下限分离分道方法,包括以下步骤:设定起始像素和结束像素,使其与滑槽的宽度相对应;将中间变量、起始像素、结束像素和设定的连通面积块下限值发送至FPGA;设定通道标号寄存器进行保存;设定比较器的输入为cal_temp和0,如果相等,则当前像素在第1个通道,对下限通道寄存器进行清零;设定比较器的输入为当前像素和0,如果大于0则将当前像素对应的连通面积块标记值保存;设定比较器组,和设定K个比较器;在I+2N时钟之后,一行像素扫描完毕,将下限通道寄存器的值发送给高速气阀控制板,满足喷气吹离要求通道置1,不满足置0。本发明精确有效地识别面积块并且做出相应操作,极大地降低了误识别或误操作的概率。
权利要求书 (12项)
说明书
附图
……
……
图1
图2
图3
法律状态时间线
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