发明专利已授权

基于关键路径分区的生成式异构逻辑优化方法

📄 申请号：CN202411632180.5 📄 发布日：2026/05/25

著录项目信息

申请日

2024-11-15

公开号

CN119416716A

公开日

2025-02-11

申请人

杭州电子科技大学

法律状态

已下证

专利类型

发明

主分类号

G06F30_337

IPC 分类号

G06F30_337 , G06F30_27 , G06N20_00 ,

技术画像

所属领域

电子设计自动化电子设计自动化集成电路设计逻辑综合与优化

应用场景

芯片设计, 集成电路, FPGA设计, 电子设计自动化, 高性能计算

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摘要

本发明公开基于关键路径分区的生成式异构逻辑优化方法。本发明方法包括：首先将数字逻辑电路转换成AIG图格式，并采用强化学习根据电路本身关键路径信息对AIG图进行分区获得关键路径感知分区以降低分区带来关键路径变化而影响时序性能；将分区后电路分别用强化学习方法自动探索适合该分区的优化结构与优化综合流，强化学习智能体以面积时延为导向选取各种结构的优化算子对分区进行优化；将优化后分区以AIG形式合并。本发明将数字逻辑电路进行针对关键路径的分区并用强化学习以面积时延为导向探索优化结构与策略，减少分区对时序性能的影响并且跳出局部最优解，获得全局更优解，同时自动探索无需人工干预可以减少芯片设计中的人工成本。

权利要求书 (12项) 说明书附图

……

图1

图2

图3

法律状态时间线

一种考虑水滴碰撞系数的接触网覆冰运行稳定性评估方法

当前第 / 件

多用户的工业物联网场景下的时延最小化卸载方法及系统

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