发明专利 已授权

基于FPGA的Tiny-yolo卷积神经网络硬件加速方法及系统

📄 申请号:CN201810523619.9 📄 发布日:2026/10/20

著录项目信息

申请日
2018-05-28
公开号
CN108805274B
公开日
2022-02-18
申请人
重庆大学
法律状态
已下证
专利类型
发明
主分类号
IPC 分类号

技术画像

应用场景

边缘计算, 智能安防, 工业视觉, 自动驾驶, 嵌入式视觉

摘要

本发明公开了一种基于FPGA的Tiny‑yolo卷积神经网络硬件加速方法及系统,其通过分析Tiny‑yolo网络并行特征,结合硬件的并行处理能力,对Tiny‑yolo卷积神经网络进行硬件加速。加速方案从3个方面对Tiny‑yolo网络进行加速改进:(1)通过多通道并行输入提升Tiny‑yolo网络的处理速度,(2)通过并行计算提升Tiny‑yolo网络卷积计算的速度,(3)通过池化嵌入减少Tiny‑yolo网络的池化过程时间。其大大提高了Tiny‑yolo卷积神经网络的检测速度。

常见问题

这项专利是否已经下证?

是的,该专利已下证,法律状态为“已下证”,公开号: CN108805274B

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权利要求书 (12项) 说明书 附图

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图1
图2
图3

法律状态时间线

议价
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📋 交易方式: 委托待转让 📌 交易状态: 在售 👁️ 浏览次数:8 ❤️ 收藏人数:93 📋 项目申报: 未申报

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