发明专利 已授权

一种PHY上行架构以降低5G定位芯片面积的方法

📄 申请号:CN202210765133.2 📄 发布日:2026/09/18

著录项目信息

申请日
2022-07-01
公开号
CN115357532B
公开日
2023-12-22
申请人
真可知
法律状态
已下证
专利类型
发明
主分类号
IPC 分类号

技术画像

应用场景

5G定位, 物联网定位, 室内定位, 移动通信终端, 芯片设计

摘要

本发明涉及5G定位芯片技术领域,具体是一种PHY上行架构以降低5G定位芯片面积的方法。包括将IFFT模块设置在HWA模块中,通过把加CP逻辑合并到PDMA_CTRL模块中,并在上行SRC_FILTER模块和DC_CANCEL模块中间加入一个SEND_BUFFER模块,用于控制数据流。本发明通过将IFFT模块设置在HWA模块中,通过把加CP逻辑合并到PDMA_CTRL模块中,并在上行SRC_FILTER模块和DC_CANCEL模块中间加入一个SEND_BUFFER模块,用于控制数据流,根据这样的方法设置,只要总线满足PHY上行数据带宽,就可以节省出60Kbyte的存储空间,在28nm工艺下可以节省约0.27mm2的面积。从而解决目前这些DRAM占用过多的面积,导致芯片的成本增加的问题。

常见问题

这项专利是否已经下证?

是的,该专利已下证,法律状态为“已下证”,公开号: CN115357532B

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权利要求书 (12项) 说明书 附图

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图1
图2
图3

法律状态时间线

同领域国内专利 · IPC: (G06F13_32)

议价
不含过户费

📋 交易方式: 委托待转让 📌 交易状态: 在售 👁️ 浏览次数:7 ❤️ 收藏人数:93 📋 项目申报: 未申报

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