发明专利已授权

一种近阈值电压全数字逐次逼近寄存器延时锁定环系统

📄 申请号：CN201710782334.2 📄 发布日：2026/07/23

著录项目信息

申请日

2017-09-02

公开号

CN107342766B

公开日

2023-08-11

申请人

合肥学院

法律状态

已下证

专利类型

发明

主分类号

H03L7_081

IPC 分类号

H03L7_081 , H03L7_099 , H03L7_18 ,

技术画像

所属领域

延时锁定环延时锁定环数字集成电路低功耗电路设计

应用场景

芯片时钟同步, 低功耗片上系统, 移动处理器, 高速接口电路, 数字通信系统

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摘要

本发明公开了一种近阈值电压全数字逐次逼近寄存器延时锁定环系统，数据选择器的输入连接系统时钟信号clkin和基于clkin产生的短脉冲信号clk_dge，数据选择器的输出连接PVT补偿延时线的输入端，PVT补偿延时线的输出端与锁定延时线的输入端连接，PVT检测器通过译码器一与PVT补偿延时线的输入端连接，逐次逼近寄存器控制器通过译码器二与锁定延时线的输入端连接，时序控制器的输出端分别连接逐次逼近寄存器控制器和相位采样器的输入端。本发明通过设计和实现基于标准单元的全数字集成电路设计流程，是一个宽工作频率范围、快速锁定、工作在近阈值电压附近、无谐波锁定和零延时陷阱问题的全数字SARDLL。

权利要求书 (12项) 说明书附图

……

图1

图2

图3

法律状态时间线

一种基于依存关系抽取评价对象的方法

当前第 / 件

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