发明专利 已授权

一种基于FPGA的动态数据加解密实现方法

📄 申请号:CN201911059711.5 📄 发布日:2026/06/16

著录项目信息

申请日
2019-11-01
公开号
CN111049639A
公开日
2020-04-21
申请人
浙江理工大学
法律状态
已下证
专利类型
发明
主分类号
IPC 分类号

技术画像

应用场景

数据传输加密, 数据存储安全, 网络安全防护, 云计算安全, 物联网安全

摘要

本发明公开了一种基于FPGA的动态数据加解密设计与实现方法。本发明采用FPGA作为主控制器完成对动态密钥加解密主状态机的设计,将整个动态密钥加解密分成3DES加解密和密钥更新两个部分;同时在加密帧数达到设定的阈值,就更新密钥和阈值,达到双重混沌态,极大的保证了数据的安全性。本发明具有高速数据处理能力,也极大的提高了加解密速度,能够满足工业网关快速加解密以及高安全性的要求。
权利要求书 (12项) 说明书 附图

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图1
图2
图3

法律状态时间线

议价
不含过户费

📋 交易方式: 委托待转让 📌 交易状态: 在售 👁️ 浏览次数:50 ❤️ 收藏人数:93 📋 项目申报: 未申报

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