发明专利已授权

可变相位累加器电路结构的全数字锁相环及锁相控制方法

📄 申请号：CN201910163527.9 📄 发布日：2026/05/06

著录项目信息

申请日

2019-03-05

公开号

CN109714046B

公开日

2024-01-23

申请人

南华大学

法律状态

已下证

专利类型

发明

主分类号

H03L7_093

IPC 分类号

H03L7_093 , H03L7_095 , H03L7_099 , H03L7_18 ,

技术画像

所属领域

全数字锁相环全数字锁相环相位累加器数字集成电路

应用场景

无线通信, 时钟恢复, 频率合成, 数据传输, 数字信号处理

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摘要

可变相位累加器电路结构的全数字锁相环及锁相控制方法，所述的全数字锁相环包括数字鉴相器模块、数字环路滤波器模块、缓冲寄存器和数控振荡器模块。数字环路滤波器模块和数控振荡器模块分别包括第一可变相位累加器、第二可变相位累加器，利用电子设计自动化技术完成各个模块电路的设计。通过采用可变相位累加器电路结构对全数字锁相环的电路结构进行优化，拓宽了全数字锁相环电路的锁相范围，提高了锁相频率，降低了系统的总功耗，并且不会增加FPGA芯片内部的逻辑资源。本发明具有锁相速度快、锁定频率范围宽、功耗低等优点，可将其作为锁相电路模块嵌入到不同的系统芯片中，具有十分广泛的用途。

权利要求书 (12项) 说明书附图

……

图1

图2

图3

法律状态时间线

20240123

✅ 授权

20190528

?? 实质审查的生效：

20190503

📄 公开

流水线电路结构的全数字锁相环及锁相控制方法

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