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摘 要:本发明提供一种I2C总线复用实现集成芯片复位系统,包括:N个第一集成芯片,和M个第二集成芯片;N,M大于等于1;中央处理模块,通过I2C总线与所述N个第一集成芯片连接,用于发送第一控制信号以控制N个第一集成芯片的读写操作,或在M个第二集成芯片发生特定状况时,发送满足第二集成芯片复位要求的第二控制信号以控制M个第二集成芯片的复位操作;逻辑控制模块,通过I2C总线中串行时钟线与中央处理模块连接,及与M个第二集成芯片连接,用于接收中央处理模块输出的第二控制信号,将第二控制信号经过逻辑处理后转换成令第二集成芯片复位的复位信号。本发明节省专用的复位芯片,节省GPIO口,减少外围电路,PCB布线更加方便。
著 录 项:
专利/申请号: | CN201510589969.1 | 专利名称: | 一种I2C总线复用实现集成芯片复位方法、系统及电子设备 |
申请日: | 2015-09-16 | 申请/专利权人 | |
专利类型: | 发明 | 地址: | |
专利状态: | 已下证 查询审查信息 | 分类号: | G06F1/24搜分类 集成电路 复位 C 集成芯片 电子 电子设备和元器件搜索 |
公开/公告日: | 转让价格: | 面议 | |
公开/公告号: | 交易状态: | 等待洽谈 搜索相似专利 |
交易方 | 企业 | 个人 |
买家 | 营业执照副本复印件(需盖公章) | 身份证复印件(签字) |
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卖家 | 营业执照副本复印件(需盖公章) | 身份证复印件(需申请人签字) |
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专利证原件(若授权下证) | 专利证原件(若授权下证) |
日期 | 法律信息 | 备注 |