发明专利已授权

一种高速并行多路分数延时滤波器实现方法

📄 申请号：CN201710520025.8 📄 发布日：2025/12/10

著录项目信息

申请日

2017-06-30

公开号

CN107332539A

公开日

2017-11-07

申请人

电子科技大学

法律状态

已下证

专利类型

发明

主分类号

H03H17_00

IPC 分类号

H03H17_00

技术画像

所属领域

数字信号处理数字信号处理滤波器设计并行计算

应用场景

通信系统, 雷达信号处理, 声呐信号处理, 电子对抗, 实时信号处理

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摘要

本发明属于通信技术领域，涉及一种基于拉格朗日插值的高速并行多路分数延时滤波器实现技术。本发明使分数延时滤波器，可以应用在高速、并行多路的条件下，同时使用拉格朗日插值算法简化了求解滤波器系数的过程。本发明所提出的基于拉格朗日插值的高速并行多路分数延时滤波器实现技术，适合在FPGA、DSP等高速平台中实现，便于实际应用。

权利要求书 (12项) 说明书附图

……

图1

图2

图3

法律状态时间线

20200915

✅ 授权

20171201

?? 实质审查的生效：

20171107

📄 公开

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