乘法器设计 - 专利交易市场|柿子坊知识产权运营平台

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法律状态：全部已授权审中

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本发明公开的一种基于4-Booth编码的低功耗乘法器，包括由至少两个编码器并联组成的编码器组，编码器组的输入端连接有位选择器，位选择器的输入端分别与乘数输入端口、被乘数输入端口连接，位选择器的输入端与乘数输入端口、被乘数输入端口之间分别连接有第一Power gating开关，编码器组的输出端通过第二Power gating开关与压缩器的输入端连接，压缩器的输出端通过第三Power gating开关与超前进位加法器的输入端连接。本发明公开的一种基于4-Booth编码的低功耗乘法器能够在保证计算结果正确的同时，降低功耗。

📄 2019102388298 📂 G06F7_523 👤 北京奕芯科技有限公司 📅 2019-03-27

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一种基于4-Booth编码的低功耗乘法器

2019102388298 · 北京奕芯科技有限公司

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